由于 trendforge.devlive.top 访问受限,请切换到 trendforge.devlive.org 域名
项目介绍
Verilator开源SystemVerilog模拟器与代码检查系统
Verilator open-source SystemVerilog simulator and lint system
智能解读
智能标签
使用场景
项目健康度
距上次更新 1 天
平台 Star TOP 10% · Forks 870
本周 +33 ⭐ · 本月 +89 ⭐
271 位贡献者 · 0 条平台评论
缺少 3 项内容
项目信息
赞赏支持
如果本站对你有帮助,欢迎打赏支持
微信
支付宝
Widget 徽章
相关项目推荐
adam-maj/tiny-gpu
一个用Verilog编写的极简GPU设计,用于从零开始学习GPU工作原理
lowRISC/opentitan
OpenTitan:开源硅基可信根
lowRISC/ibex
Ibex是一款小型32位RISC-V CPU内核,前身为zero-riscy
aws/aws-fpga
AWS EC2 FPGA硬件与软件开发工具包的官方代码库
pulp-platform/axi
用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。
hughperkins/VeriGPU
基于RISC-V指令集架构的开源GPU设计,采用Verilog实现
加载评论中...