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GitHub 2026-11-04 趋势
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数据采集日期:
2026-11-04
SystemVerilog
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verilator/verilator
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Verilator开源SystemVerilog模拟器与代码检查系统
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chipsalliance/caliptra-ss
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Caliptra子系统硬件设计资料，包含Caliptra可信根IP及附加制造商控制模块
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openhwfoundation/cvw
霸榜 5 天
CORE-V Wally 是一款可配置的 RISC-V 处理器，与 RISC-V 片上系统设计教科书相关。包含 5 级流水线，支持 A、B、C、D、F、M 和 Q 扩展，以及可选缓存、BP、FPU、VM/MMU、AHB、RAM 和外设。
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openhwfoundation/cv32e40p
CV32E40P is an in-order 4-stage RISC-V RV32IMFCXpulp CPU based on RI5CY from PULP-Platform
1.3k
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